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在研究电能质量监测中同步时钟产生原理的基础上，给出了基于FPGA的改进的微分型数字锁相环的设计方案，运用行为级描述设计实现了该系统，并利用Quartus II软件进行仿真。仿真结果验证了设计的正确性。
基于FPGA的电能质量监测中同步时钟的研究与设计
【摘 要】
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在研究电能质量监测中同步时钟产生原理的基础上，给出了基于FPGA的改进的微分型数字锁相环的设计方案，运用行为级描述设计实现了该系统，并利用Quartus II软件进行仿真。仿真结果
【机 构】
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中国矿业大学银川学院 宁夏 银川
【出 处】
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数字化用户
【发表日期】
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2004年期
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