【摘 要】
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本文在分析ＭＯＳＦＥＴ衬底电流原理的基础上，提出了一种新型抗热载流子退化效应的ＣＭＯＳ数字电路结构、即通过在受热载流子退化效应较严重的ＮＭＯＳＦＥＴ漏极串联－－肖特基二级管，来减少其所受电应力，经ＳＰＩＣＥ及电路可
【基金项目】
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国家自然科学基金资助课题 ,,国防预研项目资助课题
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本文在分析ＭＯＳＦＥＴ衬底电流原理的基础上，提出了一种新型抗热载流子退化效应的ＣＭＯＳ数字电路结构、即通过在受热载流子退化效应较严重的ＮＭＯＳＦＥＴ漏极串联－－肖特基二级管，来减少其所受电应力，经ＳＰＩＣＥ及电路可靠性模拟软件ＢＥＲＴ２．０对倒相器的模拟结果表明：该结构使衬底电流降低约５０％，器件的热载流子退化效应明显改善而不会增加电路延迟；且该电路结构中肖特基二级管可在ＮＭＯＳＦＥＴ漏极直接制作
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