【摘 要】
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本文提出了一种基于算术加法生成器的测试或内建自测试的低功耗测试方法.该方法对原测试矢量进行伪格雷码编码,优化被测电路的开关活动率,从而实现低功耗测试.8位行波进位加
【机 构】
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电子科技大学自动化学院,成都,610054;西华大学机械工程与自动化学院,成都,610039
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本文提出了一种基于算术加法生成器的测试或内建自测试的低功耗测试方法.该方法对原测试矢量进行伪格雷码编码,优化被测电路的开关活动率,从而实现低功耗测试.8位行波进位加法器和16位超前进位加法器的实验分析表明,编码后的测试矢量显著地降低了被测电路的开关活动率;基于FPGA的实验结果表明,对于8位行波进位加法器,该方法将电路的平均动态功耗降低了15.282%,对于16位超前进位加法器,则降低了12.21%.该测试方法能侦测到被测电路基本组成单元的任意组合失效;由于原电路中加法器的复用,该测试方法可将测试硬件开销降至最小,但不会降低测试性能.
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