一种减少BIST测试资源的高级寄存器分配算法

来源 :电路与系统学报 | 被引量 : 0次 | 上传用户：xzcfjeom

【摘要】

：

在高级综合阶段考虑电路的可测性有许多优点，包括降低硬件开销，减少性能的下降，并达到更高的测试效率等。本文提出了一种基于伪随机可测性方法的寄存器分配算法，来减少内建自测试

【作者】

：

李杰李锐卜爱国王超

【机构】

：

东南大学国家专用集成电路系统工程技术研究中心

【出处】

：

电路与系统学报

【发表日期】

：

2006年6期

【关键词】

：

内建自测试寄存器分配算法自可测性测试 Built-in Self-Test register allocation algorithm self te

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在高级综合阶段考虑电路的可测性有许多优点，包括降低硬件开销，减少性能的下降，并达到更高的测试效率等。本文提出了一种基于伪随机可测性方法的寄存器分配算法，来减少内建自测试（BIST）所带来的硬件开销。在基准电路上的实验结果表明：与其它BIST测试综合方法相比较，采用本论文所提的方法进行测试综合对测试资源占用最多可以降低46.8%.

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