【摘 要】
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本文介绍了以国际标准硬件描述语言ＶＨＤＬ作为输入的ＶＬＳＩ设计仿真系统的实现过程，实现了全定制式集成电路的版图设计、模拟验证与分析的全过程；解决了长期以来硬件描述语言不统一的问题；实
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本文介绍了以国际标准硬件描述语言ＶＨＤＬ作为输入的ＶＬＳＩ设计仿真系统的实现过程，实现了全定制式集成电路的版图设计、模拟验证与分析的全过程；解决了长期以来硬件描述语言不统一的问题；实现了ＶＬＳＩ设计自动化的宿愿；为教学提供了良好的实习环境。
This paper introduces the implementation process of VLSI design simulation system based on VHDL, and realizes the whole process of layout design, simulation verification and analysis of full custom integrated circuit. It solves the problem that the hardware description language has not been unified Problem; VLSI design automation to achieve the dream; for teaching to provide a good internship environment.
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