【摘 要】
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传统的数字锁相环电路通过相位比较器控制添/扣门调整分频器计数脉冲从而调整相位,但每次仅能调整一步。这不能满足快速建立位同步的要求且对相位调整的步进也缺乏灵活性。提
【机 构】
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同济大学电子与信息工程学院,上海无线电设备研究所
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传统的数字锁相环电路通过相位比较器控制添/扣门调整分频器计数脉冲从而调整相位,但每次仅能调整一步。这不能满足快速建立位同步的要求且对相位调整的步进也缺乏灵活性。提出了用可编程器件实现改进型数字锁相环的方案,使得相位比较器在判决的同时计算出分频器分频计数值误差,并用得出的误差值去补偿分频器的分频计数值。同时将分频器、添门和扣门合并为一个可以加载不同模值的可变模分频器,解决了原来数字锁相环位同步建立慢的缺点。该方法通过VHDL语言实现,并在Quartus II上验证通过,实现了位同步信号的提取。
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