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采用高速鉴频鉴相器、抗抖动电荷泵和差分对称负载延迟单元优化结构，综合分析环形振荡器各类噪声模型，设计了一种适用于HDTV的低抖动时钟电路。芯片采用SMIC 0．35μm标准CMOS工艺，3．3V电源电压。在一定测试环境下，输出30MHz时钟信号抖动σ仅为10.4ps，能很好地满足电路设计要求。
适用于HDTV的低抖动时钟电路
【摘 要】
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采用高速鉴频鉴相器、抗抖动电荷泵和差分对称负载延迟单元优化结构，综合分析环形振荡器各类噪声模型，设计了一种适用于HDTV的低抖动时钟电路。芯片采用SMIC 0．35μm标准CMOS工
【机 构】
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复旦大学专用集成电路与系统国家重点实验室
【出 处】
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微电子学
【发表日期】
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2007年1期
【基金项目】
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上海市经委“数字电视地面传输芯片”资助项目,上海市信息委“高清晰数字电视地面传输芯片设计”资助项目
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