基于Vivado HLS的Down Scaler视频系统设计

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介绍一种基于FPGA的Down Scaler视频系统设计。系统的核心部件采用Xilinx Kintex-7的板载XC7K325T芯片,系统设计使用Vivado工具,包括使用Vivado HLS进行Down Scaler模块设计。首先按照Vivado HLS的代码规范进行Down Scaler模块的C/C++代码编写,然后利用编译工具生成RTL级代码和综合结果Down ScalerIP核,最后将Down ScalerIP核与TPG、VDMA等Xilinx视频IP核互连,构建实时视频系统。在满足实时性要求和F
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