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在分析HASH算法MD5的基础上详细介绍了目前主流的4种硬件实现方式,给出了其中迭代方式和基于缩短关键路径的循环展开方式的FPGA实现。基于缩短关键路径的循环展开方式有效的压缩了一半的工作时钟数,并提高了吞吐量,是目前所给出的国内外方案中占用硬件资源较小而工作效率较高的硬件实现方式。
HASH算法MD5的高速实现
【摘 要】
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在分析HASH算法MD5的基础上详细介绍了目前主流的4种硬件实现方式,给出了其中迭代方式和基于缩短关键路径的循环展开方式的FPGA实现。基于缩短关键路径的循环展开方式有效的
【机 构】
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成都信息工程学院计算机学院,遵义医学院医学信息工程系,北京电子科技学院电子系
【出 处】
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成都信息工程学院学报
【发表日期】
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2009年02期
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