【摘 要】
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阐明了所设计的二进制运动估计的VLSI硬件结构.首先介绍了MPEG-4形状编码中BME的基本原理,以及前人设计的一种DDBME结构;接着分析指出DDBME在利用数据冗余方面的缺陷,并给出
【机 构】
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海军工程大学电气与信息工程学院,海军工程大学电气与信息工程学院武汉
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阐明了所设计的二进制运动估计的VLSI硬件结构.首先介绍了MPEG-4形状编码中BME的基本原理,以及前人设计的一种DDBME结构;接着分析指出DDBME在利用数据冗余方面的缺陷,并给出了一种改进的运动估计结构,通过扩大PE阵列以及重新安排数据的分发机制,可以达到75%的数据利用率.硬件仿真结果与软件运行结果的对比表明了本设计的正确性,综合结果也说明了本设计可以在最低5.93MHz的频率下满足MPEG-4 Core Profile & Level2的实时编码,可用于MPEG-4的VLSI实现.
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