【摘 要】
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针对小型化核磁共振成像仪主控板的功能需要提出新的设计方式,采用FPGA开发板作为主控板,以Nios II嵌入式软核作为协处理器,通过在其上移植μC/OS-Ⅱ操作系统及lwIP协议栈,实
【机 构】
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厦门大学电子科学系福建省等离子体与磁共振研究重点实验室
【基金项目】
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国家自然科学基金（11175149）资助项目
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针对小型化核磁共振成像仪主控板的功能需要提出新的设计方式,采用FPGA开发板作为主控板,以Nios II嵌入式软核作为协处理器,通过在其上移植μC/OS-Ⅱ操作系统及lwIP协议栈,实现与计算机的网络通信;使用Verilog硬件描述语言编写脉冲序列生成模块,实现对指令的解析以及执行,形成用户要求的脉冲序列。最终测试结果表明,主控板的通信速率以及通过示波器采集得到的脉冲序列均满足成像仪系统要求。而且这种软硬结合的设计方式与以往全软件的设计相比,使成像仪精度更高,性能更加稳定。
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