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为了解决用verilog HDL语言开发FPGA时某些电路容易产生“毛刺”的问题。文中通过对verilog语言特点的阐述，详细分析了编程过程中常见的两种“毛刺”信号的电路类型，最后给出了用verilog HDL语言进行设计优化的方法、程序与仿真波形。
基于FPGA的verilog HDL语言设计优化
【摘 要】
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为了解决用verilog HDL语言开发FPGA时某些电路容易产生“毛刺”的问题。文中通过对verilog语言特点的阐述，详细分析了编程过程中常见的两种“毛刺”信号的电路类型，最后给出了
【机 构】
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西安电子科技大学机电工程学院
【出 处】
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电子元器件应用
【发表日期】
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2008年11期
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