【摘 要】
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以TSMC0.18μmCMOS制程实现10位元（10-bit）、每秒取样2×107次、操作电压1.8 V的管线式（pipe-line）模拟数字转换器（ADC）芯片。本设计主要是使用1.5-bit/stage架构,并且配合运算
【机 构】
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国立台湾科技大学电子工程系,中华电信研究所
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以TSMC0.18μmCMOS制程实现10位元（10-bit）、每秒取样2×107次、操作电压1.8 V的管线式（pipe-line）模拟数字转换器（ADC）芯片。本设计主要是使用1.5-bit/stage架构,并且配合运算放大器（op amp）共享（sharing）技术,拔除传统第一级取样保持放大器（SHA,sample and hold amplifier）以节省功耗。此芯片的量测结果为输入信号频率2 MHz时,输出的SNDR与ENOB各为46.2 dB与7.32-bit,包含焊线垫片（pa
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