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以闹钟计时器的VHDL设计为例,介绍了VHDL硬件描述语言在数字系统设计中的应用及设计方法,重点探讨了有关在VHDL设计中的电路简化问题以及VHDL对数字电路教学的影响,并提出了相应的建议.
VHDL与数字电路教学
【摘 要】
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以闹钟计时器的VHDL设计为例,介绍了VHDL硬件描述语言在数字系统设计中的应用及设计方法,重点探讨了有关在VHDL设计中的电路简化问题以及VHDL对数字电路教学的影响,并提出了
【出 处】
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华北电力大学学报
【发表日期】
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2002年z1期
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