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Ｖｉｔｅｒｂｉ译码器中的大容量、宽带宽存储器限制了译码器的速度和系统的功耗，合理地组织这个存储器是提高译码器速度，降低系统功耗的关键。从电路系统角度分析了Ｖｉｔｅｒｂｉ译码器的结构，提出了一种优化设计方案。
Viterbi译码器的优化设计
【摘 要】
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Ｖｉｔｅｒｂｉ译码器中的大容量、宽带宽存储器限制了译码器的速度和系统的功耗，合理地组织这个存储器是提高译码器速度，降低系统功耗的关键。从电路系统角度分析了Ｖｉｔｅｒｂｉ译码器的结构，提出了一种优
【机 构】
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复旦大学专用集成电路与系统国家重点实验室
【出 处】
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微电子学
【发表日期】
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2000年3期
【基金项目】
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华为研究基金资助项目
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