一种用于ASIC芯片测试的多接口CPU模型的VHDL设计

来源 :电讯技术 | 被引量 : 0次 | 上传用户：stanley_lippman

【摘要】

：

为了对具有不同CPU接口的VHDL语言实现的ASIC芯片进行仿真测试,降低芯片测试的复杂性及成本,本文设计了一个专门用于芯片测试的CPU模型.模型用VHDL语言实现,设计采用了分层次

【作者】

：

程晓军葛宁冯重熙

【机构】

：

清华大学电子工程系

【出处】

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电讯技术

【发表日期】

：

2001年5期

【关键词】

：

专用集成电路硬件描述语言芯片测试多接口CPU模型 ASIC Simulation and test VHDL

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为了对具有不同CPU接口的VHDL语言实现的ASIC芯片进行仿真测试,降低芯片测试的复杂性及成本,本文设计了一个专门用于芯片测试的CPU模型.模型用VHDL语言实现,设计采用了分层次、模块化的设计思想.与现有的VHDL实现的CPU模型相比较,该模型具有结构简单、多接口、高效率、调试使用方便等特点.本文对此CPU模型的设计思想、结构作了介绍和分析.

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