【摘 要】
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这是一种双模控制的高速分数预分频电路,它的主要特点是在不降低分辨率的基础上,通过预分频电路处理压控振荡器的高频信号,并利用优化后的半速率双模分频器结构,有效提高锁相
【基金项目】
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国家重大专题课题(2011ZX02702_004)
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这是一种双模控制的高速分数预分频电路,它的主要特点是在不降低分辨率的基础上,通过预分频电路处理压控振荡器的高频信号,并利用优化后的半速率双模分频器结构,有效提高锁相环的参考频率,优化PLL的带宽,使其能有效控制环振VCO高频噪声,从而实现较好的相噪表现。利用该高速分数分频电路,在 HLMC 55 nm 低功耗工艺平台上实现了一款主频 3 GHz,Tj〈100ps，Rj约2.5 ps的 PLL,该PLL内置LPF电容,面积约 1000 μ m× 300 μ m,IO电压 3.3V 的条件下,功耗
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