【摘 要】
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本文提出的延迟锁相环结构能够提供比较宽的工作频率范围,并且可以实现延迟时间固定为一个输入时钟的周期。为了提高工作频率和避免错锁现象,该电路采用了相位选择电路和启动
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本文提出的延迟锁相环结构能够提供比较宽的工作频率范围,并且可以实现延迟时间固定为一个输入时钟的周期。为了提高工作频率和避免错锁现象,该电路采用了相位选择电路和启动控制电路。这种延迟锁相环从理论上来说,工作频率范围可以达到1/(n×Tdmax)～1/Tdmin,Tdmax是延迟单元的最大延迟时间,n为延迟线中延迟单元的数目,Tdmin是延迟单元最小的延迟时间。设计采用了2.5V,0.25μm First Silicon CMOS工艺来实现,通过仿真测得该延迟锁相环的工作频率范围为200MHz～1GHz,并且输入和输出之间的总延时恰好为一个输入时钟周期。
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