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高速ADC的低抖动时钟设计
高速ADC的低抖动时钟设计
来源 :电子设计应用 | 被引量 : 0次 | 上传用户:fly383910564
【摘 要】
:
本文首先分析了采样时钟抖动对ADC信噪比性能的影响,然后指出产生时种抖动的原因,最后给出了两种实用的低抖动采样时钟产生方案:基于低相位噪声VCO(压控振荡器)的可变采样时
【作 者】
:
赵继勇
彭飞
【机 构】
:
解放军理工大学通信工程学院电信工程系,中国人民解放军61398部队
【出 处】
:
电子设计应用
【发表日期】
:
2005年2期
【关键词】
:
ADC
抖动
低相位噪声
VCO
压控振荡器
晶振
采样时钟
高速
温度补偿
设计
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本文首先分析了采样时钟抖动对ADC信噪比性能的影响,然后指出产生时种抖动的原因,最后给出了两种实用的低抖动采样时钟产生方案:基于低相位噪声VCO(压控振荡器)的可变采样时钟的产生及基于极低相位噪声温度补偿晶振的非可变采样时钟的产生.
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