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针对大规模SOC芯片设计中BIST测试时间长和消耗面积大的问题，提出使用FPGA实现内建自测试的测试向量发生器、被测内核和特征分析器。通过VerilogHDL语言进行仿真，结果验证了所提方案的正确性和有效性。
基于FPGA的内建自测试的实现研究
【摘 要】
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针对大规模SOC芯片设计中BIST测试时间长和消耗面积大的问题，提出使用FPGA实现内建自测试的测试向量发生器、被测内核和特征分析器。通过VerilogHDL语言进行仿真，结果验证了所
【机 构】
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衡阳师范学院物理与电子信息科学系,湖南大学电气与信息工程学院
【出 处】
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衡阳师范学院学报
【发表日期】
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2009年6期
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