浮点数字信号处理器Data-RAM的RTL模型设计

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【摘要】

：

提出了一种双精度浮点数字信号处理器Data-RAM的RTL模型设计方法．分析了Data-RAM的结构和访问机制，采用自顶向下的方法和VHDL语言，实现了Data-RAM的RTL模型设计并验证了其功能的

【作者】

：

胡正伟仲顺安陈禾

【机构】

：

北京理工大学信息科学技术学院电子工程系,华北电力大学电子与通信工程系

【出处】

：

北京理工大学学报

【发表日期】

：

2007年1期

【关键词】

：

数字信号处理器 Data-RAM RTL模型

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提出了一种双精度浮点数字信号处理器Data-RAM的RTL模型设计方法．分析了Data-RAM的结构和访问机制，采用自顶向下的方法和VHDL语言，实现了Data-RAM的RTL模型设计并验证了其功能的正确性．该模型支持3地址独立进行数据存取，支持字节、半字、字的读写访问和双字的读访问．在访问地址不冲突的前提下，最大可以在同一时钟周期进行2次64bit的读操作和1次32bit读写操作．Data—RAM的RTL模型设计为门级和物理级的性能设计提供了参考．

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