应用于AVS视频解码器的VLD设计

来源 :微机发展 | 被引量 : 0次 | 上传用户：virtualboxscdl

【摘要】

：

设计了一种可应用于国家标准AVS(Audio Video Coding Standard)的变字长解码器,根据码流特点进行硬件模块划分;采用桶形移位器并行解码,每个时钟解一个码字,采用Verilog语言

【作者】

：

赵阳生黄晁刘明业

【机构】

：

北京理工大学ASIC研究所,中国科学院

【出处】

：

微机发展

【发表日期】

：

2005年9期

【关键词】

：

视频解码变字长解码 AVS video decoding variable length decoding AVS

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设计了一种可应用于国家标准AVS(Audio Video Coding Standard)的变字长解码器,根据码流特点进行硬件模块划分;采用桶形移位器并行解码,每个时钟解一个码字,采用Verilog语言进行设计、模拟,通过了FPGA验证.用0.18μmCMOS工艺库综合,电路规模为1.6万门左右,最高频率能够达到166MHz,可实时解码720p/1080i高清AVS码流.

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