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设计实现了一种基于FPGA的，可用于多数据缓存的、能够高效利用带宽的多端口SDRAM控制器。本文使用状态机的设计思想，采用Verilog硬件描述语言设计了时序控制程序。得到的SDRAM读写信号仿真波形图时序合理、逻辑正确。并成功应用到视频数据采集显示的系统中，能够达到实时显示的要求。
多端口SDRAM控制器的设计与实现
【摘 要】
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设计实现了一种基于FPGA的，可用于多数据缓存的、能够高效利用带宽的多端口SDRAM控制器。本文使用状态机的设计思想，采用Verilog硬件描述语言设计了时序控制程序。得到的SDRAM
【机 构】
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哈尔滨理工大学计算机科学与技术学院
【出 处】
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微计算机信息
【发表日期】
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2009年14期
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