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“时钟脉冲控制器”是指能够控制时钟脉冲按照预定的数目、完整无缺地发出的电路．文章介绍了在MAX＋plusⅡ平台下用VHDL语言进行时钟脉冲控制器设计的主要流程、VHDL程序及仿真波形，通过仿真波形验证了设计的正确性．
基于VHDL和MAX＋plusⅡ的时钟脉冲控制器的设计与仿真
【摘 要】
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“时钟脉冲控制器”是指能够控制时钟脉冲按照预定的数目、完整无缺地发出的电路．文章介绍了在MAX＋plusⅡ平台下用VHDL语言进行时钟脉冲控制器设计的主要流程、VHDL程序及仿真
【机 构】
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渭南师范学院物理系
【出 处】
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渭南师范学院学报
【发表日期】
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2007年5期
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