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介绍了一种设计同步时序逻辑电路的方法。该方法之关键在于直接从时序电路的状态转换图获得了Ｊ－Ｋ，Ｄ和Ｔ触发器的激励方程式。采用该方法设计了几个实例，并由此验证了其正确性和有效性。
一种设计同步时序电路的新方法
【摘 要】
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介绍了一种设计同步时序逻辑电路的方法。该方法之关键在于直接从时序电路的状态转换图获得了Ｊ－Ｋ，Ｄ和Ｔ触发器的激励方程式。采用该方法设计了几个实例，并由此验证了其正确性和有效性
【机 构】
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江苏理工大学
【出 处】
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微电子学
【发表日期】
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1999年1期
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