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【正】在ASIC设计过程中,要想在计划进度内达到既定的设计性能,保持信号的完整性至关重要。技术按比例缩小、时钟频率的增加和更高度的片上集成等趋势,都对噪音和信号完整性有着实质的影响。技术按比例缩小使得互连和器件封装愈发成为重要的
解决多业务网络ASIC设计中 信号完整性带来的严峻挑战
【摘 要】
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【正】在ASIC设计过程中,要想在计划进度内达到既定的设计性能,保持信号的完整性至关重要。技术按比例缩小、时钟频率的增加和更高度的片上集成等趋势,都对噪音和信号完整性
【机 构】
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杰尔系统公司设计方法组总监,杰尔系统公司信号完整性和互连分析组经理
【出 处】
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中国集成电路
【发表日期】
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2003年51期
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