比特平面并行的EBCOT编码及其VLSI结构

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该文提出了比特平面并行处理的EBCOT编码算法.通过分析JPEG2000中EBCOT编码结构,指出每一个比特平面的编码信息可以同时获得,从而给出了比特平面并行处理的块编码方法,并且详细说明了实现的VLSI结构.与现有的结构相比,该结构具有并行度高、避免编码位置的时钟浪费等特点.从实验结果表明,比特平面并行处理方式所需的时钟周期最少,FPGA原型系统最高时钟频率可达52MHz,图像质量达到了公布的JPEG2000标准.
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