【摘 要】
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提出了一种新型的数字锁相环(DPLL),它的相频检测器采用全新的设计方法,与传统电荷泵锁相环相比,具有快速锁定、低抖动、低功耗、频率范围宽、且能消除相位"死区"的优点.锁相
【机 构】
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北京工业大学光电子实验室,中国华大集成电路设计中心
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提出了一种新型的数字锁相环(DPLL),它的相频检测器采用全新的设计方法,与传统电荷泵锁相环相比,具有快速锁定、低抖动、低功耗、频率范围宽、且能消除相位"死区"的优点.锁相环在1.8 V外加电源电压时,工作在60～600 MHz宽的频率范围内,最大功耗为3.5 mW.采用分数分频技术,具有较小的输出频率间隔,并利用Σ-Δ调制改善相位噪声性能.设计采用0.18 μm,5层金属布线工艺.峰-峰相位抖动小于输出信号周期(Tout)的0.5%,锁相环的锁定时间小于参考频率预分频后信号周期(Tp
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