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本文探讨了Viterbi译码器的ACS模块的设计,在面积高效(areaeffcient)结构的基础上,提出了一种新的状态路径距离存储管理的方法,在Quartus上完成设计,选用APEX系列芯片验证了设计。
Viterbi译码器ACS模块的设计
【摘 要】
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本文探讨了Viterbi译码器的ACS模块的设计,在面积高效(areaeffcient)结构的基础上,提出了一种新的状态路径距离存储管理的方法,在Quartus上完成设计,选用APEX系列芯片验证了
【机 构】
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丽水学院电子信息工程系
【出 处】
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中国科技信息
【发表日期】
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2005年13期
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