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2．5Gbps发接器系统均衡器电路的设计

来源 :固体电子学研究与进展 | 被引量 : 0次 | 上传用户：ly_exe
【摘 要】
：
采用片上可编程均衡技术,设计了用于数据率为2.5 Gbps发接器系统接收端的均衡器电路.电路采用0.18 μm标准CMOS工艺和1.8 V单电源.用UMC模型Cadence SpectreS软件进行了仿真,
【作 者】
：
覃正才 王涛 洪志良 
【机 构】
：
复旦大学集成电路设计实验室
【出 处】
：
固体电子学研究与进展
【发表日期】
：
2002年3期
【关键词】
：
码间干扰 均衡器 发接器 电路设计 inter symbol interference (ISI)  equalizer  transceiver 
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采用片上可编程均衡技术,设计了用于数据率为2.5 Gbps发接器系统接收端的均衡器电路.电路采用0.18 μm标准CMOS工艺和1.8 V单电源.用UMC模型Cadence SpectreS软件进行了仿真,电路在0～125°C范围内,三种工艺角和电源电压变化±10%的条件下能够正确地工作.在1.8 V电源、75°C和tt工艺角条件下,电路的总功耗为40 mW.
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