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H.264/AVC硬件解码器设计及其验证策略
H.264/AVC硬件解码器设计及其验证策略
来源 :微电子学 | 被引量 : 0次 | 上传用户:soboy1478
【摘 要】
:
提出了一种H.264/AVC硬件解码器的SOC/ASIC设计方案,并在实现电路的基础上,重点分析了基于文中的硬件设计方案的验证策略。该设计方案已经在基于FPGA的验证平台上通过功能原型验证
【作 者】
:
石磊
林涛
焦孟草
【机 构】
:
同济大学超大规模集成电路研究所
【出 处】
:
微电子学
【发表日期】
:
2006年1期
【关键词】
:
H.264/AVC
专用集成电路
解码器
FPGA
验证
H. 264/AVC
ASIC
Decoder
FPGA
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提出了一种H.264/AVC硬件解码器的SOC/ASIC设计方案,并在实现电路的基础上,重点分析了基于文中的硬件设计方案的验证策略。该设计方案已经在基于FPGA的验证平台上通过功能原型验证,结果证明,这是一个完全可行的H.264/AVC硬件解码设计方案。
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