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文章提出一种二阶全阶全数字锁相环的实现方法，由于采用鉴频、鉴相并置方法，网时把数字滤波器融入其中，采用小数分频器构成数失振荡器，从ＴＵ＝１２中恢复Ｅ１时钟信号。经硬件实验证实，电路的性能指标完全可以满足ＩＴＵ－Ｔ的有关标准。采用全数字锁相环对系统集成有明显的好处。
用于SDH 2Mb／s和输出的一种全数字锁相环设计与实现
【摘 要】
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文章提出一种二阶全阶全数字锁相环的实现方法，由于采用鉴频、鉴相并置方法，网时把数字滤波器融入其中，采用小数分频器构成数失振荡器，从ＴＵ＝１２中恢复Ｅ１时钟信号。经硬件实验证实，电路的性
【机 构】
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西安邮电学院计算机系
【出 处】
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微电子学与计算机
【发表日期】
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2000年5期
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