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基于并联取小时钟结构的ECL时序电路设计研究
本文主要讨论了三值ECL时序电路的设计方法,提出了ECL时序电路中一种新型的时钟结构——并联取小时钟结构,并设计了基于此种时钟结......
学位
ECL电路
多值逻辑
开关级设计
时序电路
时钟结构
D型锁存器
状态寄存器
倒序状态分配
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