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会议论文
图像编码器硬件设计中的信号完整性
图像编码器硬件设计中的信号完整性
来源 :第四届全国信号和智能信息处理与应用学术会议 | 被引量 : 0次 | 上传用户:xiaogaojuanJUAN
【摘 要】
:
在高速数字电路设计中,信号完整性问题以及互连延迟引起的时序问题是十分重要的。设计了以TMS320C6000系列DSP为核心的图像编码器硬件,利用Cadence公司的EDA工具SPB软件包,
【作 者】
:
姚春莲
葛宝珊
【机 构】
:
北京工商大学,北京 100037
【出 处】
:
第四届全国信号和智能信息处理与应用学术会议
【发表日期】
:
2010年期
【关键词】
:
图像编码器
硬件设计
信号完整性
数字电路设计
TMS320C6000
编码器硬件
时序问题
互连延迟
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在高速数字电路设计中,信号完整性问题以及互连延迟引起的时序问题是十分重要的。设计了以TMS320C6000系列DSP为核心的图像编码器硬件,利用Cadence公司的EDA工具SPB软件包,对关键电路的信号完整性进行分析,给出了叠层设置及验证结果。
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