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本文通过对RS编解码原理的研究,对相关算法进行优化,用Verilog语言在FPGA上实现了RS(255,239)编解码器,最终的仿真结果证实该编码器、解码器占用的系统资源少,运行时间快,可以满足在通信系统上的要求。
高速RS编解码器在FPGA上的具体实现
【摘 要】
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本文通过对RS编解码原理的研究,对相关算法进行优化,用Verilog语言在FPGA上实现了RS(255,239)编解码器,最终的仿真结果证实该编码器、解码器占用的系统资源少,运行时间快,可
【机 构】
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中国航天科工集团第三研究院8357所,天津300141
【出 处】
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全国抗恶劣环境计算机第十七届学术年会
【发表日期】
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2007年9期
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