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集成电路设计中时钟树网络性能直接决定了芯片的整体性能,而时钟不确定性是影响时钟性能的主要原因.本文了首先分析了时钟不确定性的产生原因,明确了减小时钟不确定性的原理,在此基础上剖析目前常用的时钟树网络结构的优缺点,最后提出了时钟树网络设计研究的发展方向.
提高时钟树网络性能的方法研究
【摘 要】
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集成电路设计中时钟树网络性能直接决定了芯片的整体性能,而时钟不确定性是影响时钟性能的主要原因.本文了首先分析了时钟不确定性的产生原因,明确了减小时钟不确定性的原理,
【机 构】
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中国航空计算技术研究所 西安710068
【出 处】
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第十四届计算机工程与工艺会议(NCCET'10)
【发表日期】
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2010年期
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