【摘 要】
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在片上嵌入式多核处理器点对点架构上实现JPEG解码算法，通过各个处理器核并行执行JPEG解码算法，对各个处理器核需要完成任务的分解进行优化，建立专用数据通道来提高JPEG解码速度
【机 构】
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合肥工业大学微电子设计研究所中国兵器214研究所合肥工业大学微电子设计研究所
【出 处】
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第七届中国通信集成电路技术与应用研讨会
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在片上嵌入式多核处理器点对点架构上实现JPEG解码算法，通过各个处理器核并行执行JPEG解码算法，对各个处理器核需要完成任务的分解进行优化，建立专用数据通道来提高JPEG解码速度，并在FPGA上实现。实验结果表明，在四个NIOs Ⅱ嵌入式处理器核点对点架构上实现的JPEG图像解码速度是单处理器核解码速度的2.6倍。
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