【摘 要】
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对数字系统进行测试的基本做法是:从输入端加若干激励信号,观察由此产生的输出响应,并与预期的正确结果进行比较, 一致则表示系统正常,不一致则表示系统有故障,这里的关键是
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对数字系统进行测试的基本做法是:从输入端加若干激励信号,观察由此产生的输出响应,并与预期的正确结果进行比较, 一致则表示系统正常,不一致则表示系统有故障,这里的关键是该对系统施加些什么样的输入激励才可确认系统工作正常.该课题是基于这一目的,针对组合电路和时序电路的测试生成思想,研究了D算法,G-F二值算法及时序电路的单故障压缩方法.设计了用VHDL描述的16位地址序列发生器电路,利用成熟的测试理论生成测试向量,使其在自动测试时,尽量覆盖数字插件电路板的所有可能故障.同时,尽量采用了测试向量的压缩方法使该系统的测试步骤和测试所花费的时间得以减少.实验证明可使故障覆盖率达到90﹪以上.另外,因在数字电路板故障诊断的整个系统中,大量的测试向量的存储采用具有高速和大容量优点的SDRAM,因此用VHDL语言编写了SDRAM的接口控制电路,并采用可编程逻辑器件实现.
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