高端路由器设备的时钟板设计与FPGA实现

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同步以太网是一种基于物理层的时钟同步技术,能够很好地解决在网络1P化过程中,传统TDM业务与分组网络之间存在的同步与定时问题。单一的同步以太网只适用于没有时间同步要求的情况,而对于有时间同步要求的应用场景,则通常采用在同步以太网的基础上结合IEEE1588V2协议的方法来实现系统的高精度时间同步要求。基于IEEE1588V2的同步以太网解决了通用以太网延迟时间长且同步能力差的瓶颈,因此受到了业内人士的广泛关注。本文首先研究了分组网络中的时钟同步和时间同步方式,选出了适合于本课题的同步以太网时钟同步方式和IEEE1588V2时间同步方式。接着,通过对高端路由器系统内的时钟同步和时间同步方案进行分析,提出了高端路由器设备中时钟板的功能和主要技术指标。随后,制定时钟板的总体设计方案,根据具体方案对芯片进行选型,并设计了各模块的硬件电路。最后,对时钟板上逻辑部分所要实现的功能进行分析,将逻辑划分为三级时钟处理、Localbus接口和时间同步处理3大模块,并对每个模块的实现方案和时序设计进行详细的说明,通过Modelsim仿真的方式验证了逻辑设计的正确性。
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