基于CPLD的频率计的设计

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频率检测是电子测量领域的最基本也是最重要的测量之一。频率信号抗干扰能力强、易于传输,可以获得较高的测量精度,所以测频方法的研究越来越受到重视。等精度测量消除了对被测信号计数所产生的正负1误差,并且达到了在整个测试频段的等精度测量,测量信号的精度不随所测信号频率的变化而变化。本课题研究的等精度数字频率计的设计,采用当今电子设计领域流行的EDA技术,以CPLD为核心,配合STC12LE1052单片机,采用多周期同步测频原理,实现了1Hz~1MHz信号频率的等精度频率测量。设计中采用ALTEAR公司MAXII系列芯片中的EPM240T100芯片完成键盘档位译码、对被测信号的计数和BCD译码。采用STC12LE1052单片机,根据CPLD发出的键盘译码信息发送预置闸门脉宽给CPLD控制其计数,并在计数结束后计算出被测信号频率值发送给CPLD,并控制数码管的显示位。在ALTEAR公司提供的QuartusII平台上,用VHDL语言编程完成CPLD的软件设计、编译、调试、仿真和下载。系统将单片机的控制灵活性及CPLD芯片的现场可编程性相结合,不但大大缩短了开发研制周期,而且使本系统具有结构紧凑、体积小,可靠性高,测频范围宽、精度高等优点。本文详细论述了系统自上而下的设计方法及各部分硬件电路组成及单片机、CPLD的软件编程设计,并且制作实物进行了仿真和硬件验证,达到了较高的测量精度和测量速度。
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