【摘 要】
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基于反激式DC-DC变换器拓扑，设计了一种精确的谷底检测电路，可以在比较宽的频率范围内检测到电压谷底。同时，为解决高频谐振条件下器件延时给检测精度带来的影响，引入一个迟滞比
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基于反激式DC-DC变换器拓扑，设计了一种精确的谷底检测电路，可以在比较宽的频率范围内检测到电压谷底。同时，为解决高频谐振条件下器件延时给检测精度带来的影响，引入一个迟滞比较器，通过调节其迟滞窗口来抵消延时。该电路已在1．5μmBCD工艺下设计完成。测试结果表明，电路工作正常，预期的功能均已实现。
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