基于FPGA的流水线单精度浮点数乘法器设计

来源 :微型机与应用 | 被引量 : 0次 | 上传用户：itsmoreaaron

【摘要】

：

针对现有的采用Booth算法与华莱士（Wallace）树结构设计的浮点乘法器运算速度慢、布局布线复杂等问题，设计了基于FPGA的流水线精度浮点数乘法器。该乘法器采用规则的Vedic算法结

【作者】

：

彭章国张征宇王学渊赖瀚轩茆骥

【机构】

：

西南科技大学信息工程学院,中国空气动力研究与发展中心

【出处】

：

微型机与应用

【发表日期】

：

2017年4期

【关键词】

：

浮点乘法器超前进位加法器华莱士树流水线结构 Vedic算法 Booth算法

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针对现有的采用Booth算法与华莱士（Wallace）树结构设计的浮点乘法器运算速度慢、布局布线复杂等问题，设计了基于FPGA的流水线精度浮点数乘法器。该乘法器采用规则的Vedic算法结构，解决了布局布线复杂的问题；使用超前进位加法器（Carry Look-aheadAdder，CLA）将部分积并行相加，以减少路径延迟；并通过优化的4级流水线结构处理，在Xilinx ISE 14．7软件开发平台上通过了编译、综合及仿真验证。结果证明，在相同的硬件条件下，本文所设计的浮点乘法器与基4-Booth算法浮点乘法

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