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由于科学技术的快速提高，单一芯片中所包含的晶体管的数目越来越多，相对造成了芯片可测试度的降低．以及测试成本的增加。传统的基于扫描的测试方法中，常会有测试时间太长的缺点。本文采用了向量压缩．并用Test-Per-Clock的方式来处理待测电路，减少了测试时间，不影响故障覆盖率。
一种改进的基于扫描的电路设计
【摘 要】
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由于科学技术的快速提高，单一芯片中所包含的晶体管的数目越来越多，相对造成了芯片可测试度的降低．以及测试成本的增加。传统的基于扫描的测试方法中，常会有测试时间太长的缺点。
【机 构】
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江南大学,中国电子科技集团公司第五十八研究所
【出 处】
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微计算机信息
【发表日期】
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2006年02Z期
【基金项目】
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本文获电子元器件可靠性物理及其应用技术国防科技重点实验室基金资助,资助号：51433020105DZ6801
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