【摘 要】
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本文介绍一种基于FPGA的UHF RFID阅读器基带处理电路的设计.该基带处理电路兼容EPC Class-1 Generation-2UHF RFID协议,内嵌了Nios Ⅱ软核嵌入式处理器.基带处理中的大部分操
【机 构】
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杭州电子科技大学微电子CAD研究所,UT斯达康宽带事业部
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本文介绍一种基于FPGA的UHF RFID阅读器基带处理电路的设计.该基带处理电路兼容EPC Class-1 Generation-2UHF RFID协议,内嵌了Nios Ⅱ软核嵌入式处理器.基带处理中的大部分操作,如CRC校验、PIE编码、ASK/PSK解调、FW0/Miller解码等由硬件实现,处理速度较快:而内嵌的处理器使得本设计对协议的支持更加灵活.本设计在Stratix IS25F780C5 FPGA平台上实现,能快速准确地完成RFID基带处理任务.
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