【摘 要】
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为在实时通信系统中有效利用多维网格编码调制（MDTCM）的短码特性,设计了一种适合FPGA实现的高效多维网格编码译码器。在该设计中,提出了一种易于硬件实现的改进归一化译码算法,
【机 构】
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中国电子科技集团公司第十研究所,全军后勤信息中心
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为在实时通信系统中有效利用多维网格编码调制（MDTCM）的短码特性,设计了一种适合FPGA实现的高效多维网格编码译码器。在该设计中,提出了一种易于硬件实现的改进归一化译码算法,采用四级流水线和乒乓环结构,并充分利用译码算法中的固有特性,有效降低了资源消耗和译码延迟。测试表明,该设计简单可靠,性能稳定,易于移植扩展,非常适合实时通信场合的应用,目前该译码器已成功应用于某实时通信系统中。
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