【摘 要】
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设计了最高采样率为1 GHz的ASIC数字正交混频器.基于正交混频的基本原理,优化了正交混频的算法,优化后的算法节省了硬件资源.为了达到最高采样率的要求,提出了并行结构的电路
【机 构】
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中国电子科技集团公司第五十八研究所,江苏,无锡,214035
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设计了最高采样率为1 GHz的ASIC数字正交混频器.基于正交混频的基本原理,优化了正交混频的算法,优化后的算法节省了硬件资源.为了达到最高采样率的要求,提出了并行结构的电路实现方法.采用MAT-LAB对正交混频算法进行定点误差分析和频谱分析,并根据MATLAB分析结果设计硬件代码.设计的正交混频器模块应用于ADC电路.基于65 nmn CMOS工艺流片后,实际测试结果表明,所设计的正交混频器模块能够满足信噪比和采样率的设计要求.
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