【摘 要】
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伪码生成器是直接序列扩频系统中的重要一环。因此,设计了一种基于FPGA实现的实时生成码发生装置,利用双端口RAM码NCO结构来实现接收机全局时钟下码频率的转换和初相的设置,
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伪码生成器是直接序列扩频系统中的重要一环。因此,设计了一种基于FPGA实现的实时生成码发生装置,利用双端口RAM码NCO结构来实现接收机全局时钟下码频率的转换和初相的设置,通过RAM输入数据位宽实现多通道码输入。每个码周期结束对码初相重新置位,减少了恶劣太空环境下发生单粒子翻转导致数据出错的影响,可以广泛应用于直扩系统接收机。
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