基于可编程逻辑器件的二维卷积器IP设计

来源 :中南民族大学学报(自然科学版) | 被引量 : 0次 | 上传用户：wuhaozzu

【摘要】

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提出了一种图像处理用二维卷积器的IP设计.该卷积器的设计基于将一帧完整的图像分解为多个相互重叠的垂直窄带,而将每个垂直带视为一幅完整图像进行处理,因此大大减少了系统

【作者】

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熊承义田金文

【机构】

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中南民族大学电子信息工程学院,华中科技大学图像识别与人工智能研究所

【出处】

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中南民族大学学报(自然科学版)

【发表日期】

：

2003年1期

【关键词】

：

二维卷积器 IP设计可编程逻辑器件图像处理 VERILOG HDL语言专用集成电路 2-d convolver FPGA IP

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提出了一种图像处理用二维卷积器的IP设计.该卷积器的设计基于将一帧完整的图像分解为多个相互重叠的垂直窄带,而将每个垂直带视为一幅完整图像进行处理,因此大大减少了系统所用移位寄存器的数目,但系统的性能下降较少.用Verilog HDL语言描述了整个系统的设计,并在Xilinx公司的ISE4.1集成开发环境下进行了仿真和逻辑综合,给出了实现的结果.

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