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提出了一种数字接收机中符号同步的硬件设计方案.该方案属于异步采样恢复法,其插值滤波器的设计采用了理想插值算法加窗处理,较传统的拉格朗日插值有更好的频域特性.该设计方案已用VerilogHDL实现,并通过了综合及时序验证.
一种基于插值算法符号同步的硬件设计
【摘 要】
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提出了一种数字接收机中符号同步的硬件设计方案.该方案属于异步采样恢复法,其插值滤波器的设计采用了理想插值算法加窗处理,较传统的拉格朗日插值有更好的频域特性.该设计方
【机 构】
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同济大学电子与信息工程学院
【出 处】
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电子技术应用
【发表日期】
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2005年6期
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