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通过锁相环路的应用介绍,说明了全数字锁相环的优点,详细讨论了如何在FPGA中利用Verilog语言VHDL语言混和实现全数字锁相测速方案和利用锁相环DPLL中,可逆计数器模值的能修改特性,来控制DPLL的跟踪补偿和锁定时间,DPLL的中心频率以及消除'纹波'的方法.
一种基于FPGA的数字锁相环测速实现方法
【摘 要】
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通过锁相环路的应用介绍,说明了全数字锁相环的优点,详细讨论了如何在FPGA中利用Verilog语言VHDL语言混和实现全数字锁相测速方案和利用锁相环DPLL中,可逆计数器模值的能修改
【机 构】
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宝鸡职业技术学院,宝鸡文理学院
【出 处】
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宝鸡文理学院学报(自然科学版)
【发表日期】
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2005年1期
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